TP

Dure : 6h00

TSTI2 anne 2010/2011

SIMULATION Les registres dcalage Liaisons srie

EMETTEUR EMETTEUR D7 D0 1 0 0 1 1 1 0 1 D7 D0 D7 1 0 1 1 1 0 0 1

horloge

REGISTRE A REGISTRE A DECALAGE DECALAGE

REGISTRE A REGISTRE A DECALAGE DECALAGE

horloge D0

1 0 0 1 1 1 0 1 D7 RECEPTEUR RECEPTEUR D0

Prrequis : -

fiche "les liaisons sries"

Objectifs : -

compteur registre dcalage les liaisons sries asynchrones

simulation avec le logiciel PROTEUS-ISIS

SECTION STI

ELECTRONIQUE

La premire partie du TP porte sur le compteur 74ls161. Vous verrez dans la seconde partie l'tude des registres dcalage puis l'utilisation d'un registre dcalage dans une liaison srie asynchrone. Pour ce TP vous rdigerez un compte-rendu dans lequel vous collerez les chronogrammes des feuilles rponses.

CTR DIV16

1. RAPPEL SUR LE COMPTEUR Soit le compteur 74LS161 : 1.1 En utilisant sa documentation constructeur (rseau), donner le rle et le niveau ou front actif de chaque entre et de la sortie RCO. 1.2 Complter les chronogrammes 1 de la feuille rponse. 1.3 Saisir le schma sous PROTEUS ISIS. Saisir les stimuli et vrifier vos chronogrammes.

CLR (1) LOAD (9) ENT (10) ENP (7) CLK (2)

CT=0 M1 M2 G3 G4 C5/2,3,4+

3CT=15

(15)

RCO

A (3) B (4) C (5) D (6)

1,5D

[1] [2] [3] [4] 74LS161

(14)

QA QB QC QD

(13)

(12)

(11)

2. La liaison srie

2.1 Dans une transmission srie, quel est le rle des registres dcalage ? 2.2 Quels sont les deux types de registres dcalage utiliser dans le cas dune liaison srie ?

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3. Le registre dcalage 74ls166 La documentation du circuit est sur le rseau (utilisez le site STI2). Les noms des broches varient dun constructeur lautre, soyez vigilants ! Aidez vous des n de broches. 3.1 3.2 3.3 3.4 Quel est le type de ce registre ? Quel type de bascules compose ce circuit ? Complter sur la feuille rponse la table de vrit du registre. Complter les chronogrammes n2 de la feuille rponse. Fates contrler par le professeur. Mettre en vidence ( couleurs ) sur le chronogramme de Q le mot srie de sortie. 3.5 Saisir sous PROTEUS le schma ci-dessous. Vrifier vos chronogrammes en simulant le composant. Conclure.

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4. LIAISON SERIE : convertisseur parallle / srie La structure ci-dessous permet de convertir un mot // sur 8 bits en un mot srie en ajoutant un bit de START et un ou deux bits de STOP.

4.1 Rappeler le rle du bit START et du bit STOP dans une liaison srie asynchrone ? On donne les chronogrammes de CLK, LD , S0, et READY .

CLK
K

LD S0
Start D0 D1 D2 D3 D4 D5 D6 D7 stop stop start D0 D1

READY
14 15 0 1 2 3 4 5 6 7 8 9 10 10 10 10 10 14 15 0 1

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4.2 Justifier le fait que la valeur dcimale 10, sur les sorties Q 3 Q0 du compteur, permette le blocage du compteur. Faire un schma. On considre le RESET inactif dans les questions suivantes. 4.3 READY = 0L. La conversion commence par une impulsion ngative sur lentre LD du circuit. Que se passet-il pour le compteur ? Quelle est alors la valeur en Q3 Q2 Q1 Q0 ? (binaire puis dcimale). 4.4 LD repasse au niveau haut. Que se passe-t-il pour le compteur au front actif suivant de CLK ? quelle est la valeur dcimale de sortie ? 4.5 Donner alors l'tat de RCO (broche 15 du compteur). 4.6 En dduire l'tat de S0. En vous aidant de la trame RS232, quoi correspond ce premier bit ? 4.7 Quelle incidence sur le registre a eu le passage 0L de LD ? 4.8 Au front actif suivant sur CLK, quel est ltat des sorties du compteur ? A quoi est gal S0 ? 4.9 Que fait le registre chacun des coups d'horloge suivants ? En dduire le mot srie qui apparat en S0. 4.10Que se passe-t-il lorsque les sorties du compteur retrouvent la valeur dcimale 8 ? Quel tat prend la sortie S0 ? Justifier par un schma. A quoi correspond cet tat ? 4.11Complter les chronogrammes n3 de la feuille rponse. 4.12Copier le fichier schma serie232_eleve.dsn du rpertoire v:\commun_elec\tsti2\TP\liaisons serie\ sous votre compte. diter les stimuli. 4.13Lancer la simulation. Imprimer les traces. Mettre en vidence sur le chronogramme de S0 le mot srie. Changer de code dentre, vrifier que lon retrouve bien ce code en sortie.

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FEUILLE RPONSE (dcouper et coller dans votre compte-rendu) chronogrammes n1 - rponse la question 1.2

tableau de fonctionnement du registre 74ls166 question 3.3 On considre CLEAR = 1L.

SHIFT/LOAD CLOCK CLOCK INHIBIT

schma interne (noter les tats logiques)

fonctionnement
analyser le fonctionnement (tat de la sortie QA) pour les deux tats possibles de la DATA (A)

conclure sur le rle de CLOCK INHIBIT

Que recopie la sortie de la premire bascule sur les fronts actifs de CLOCK ? Que recopie la sortie des autres bascules ? En dduire le rle de l'entre SERIAL INPUT

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chronogrammes n2 - rponse la question 3.4

chronogrammes n3 - rponse la question 4.11

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