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salida de la compuerta 1. Las entradas son 1 y 1 a lo que la compuerta NOR responderá
con un 0 a la salida (Q´ ). Como esta estaba en 0, el FF queda en un estado estable y
no hay mas cambios.
En esta tabla se muestra que el estado no valido va a ser 0,0 ya que nos muestra una
contradicción. Y nuestro estado inicial sera 1,1
S R Q Q’
1 0 0 1
1 1 0 1
0 1 1 0
1 1 1 0
0 0 1 1
Este flip-flop se denomina como "universal" ya que los demás tipos se pueden construir
a partir de él. En el símbolo anterior hay tres entradas síncronas (J, K y CLK). Las
entradas J y K son entradas de datos, y la entrada de reloj transfiere el dato de las
entradas a las salidas. Observamos los modos de operación en la parte izquierda y la
tabla de la verdad hacia la derecha. La línea 1 muestra la condición de "mantenimiento",
o inhabilitación. La condición de "reset" del flip-flop se muestra en la línea 2 de la tabla
de verdad. Cuando J=0 y K=1 y llega un pulso de reloj a la entrada CLK, el flip-flop
cambia a 0(Q=0). La línea 3 muestra la condición de "set" del flip-flop JK. Cuando J=1 y
K=0 y se presenta un pulso de reloj, la salida Q cambia a 1. La línea 4 muestra una
condición muy difícil para el flip-flop JK que se denomina de conmutación.
Son utiles para colocar los flip-flops en un estado inicial, antes de comenzar con su
funcionamiento de forma síncrona, sin la necesidad de utilizar un pulso de reloj.
Estas entradas pueden actuar con un nivel ALTO ( 1 ) o con un nivel BAJO (0) .
En las tablas de especificaciones de los circuitos integrados se incluyen tablas que
indican en cada caso la forma de funcionamiento. En el caso que se muestra, al aplicar
un 0 en la entrada de clear el FF se fijará en 0.
– La entrada PRESET (poner), que sirve para poner directamente en el biestable un
“1” en la salida Q
– La entrada CLEAR (borrar), que sirve para poner en “0” en la salida Q.
Las entradas CLEAR (CLR) y PRESET son activas en bajo (ver la pequeña esfera en
estas entradas) y se imponen en la salida Q sin importar el estado del reloj y de las
entradas J y K. (ver las entradas J, K y el reloj con una X). Para que las entradas J y K
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y el reloj sean funcionales, las entradas Clear y Preset deben de estar en nivel “alto”
(no activas)
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8. Muestre lossímbolos de losflip-flops de acuerdo a la norma
ANSI/IEEE y a la norma IEC. Presentar los diagramas
esquemáticos de los C.I. utilizados en esta práctica, así como
sus tablas de verdad.
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9. Típicamente, las hojas de especificaciones de los fabricantes especifican
cuatro tipos de retardos asociados con los flip-flop. Nombrar y describir cada
uno de ellos
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