SISTEMAS ELECTRNICOS DIGITALES.

CURSO 04/05
Prctica 4: Interrupciones 80C537

PRCTICA 4: INTERRUPCIONES 80C537

1.1
 FUENTES DE INTERRUPCIN 1.2

14 fuentes de interrupcin:
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7 Generadas por los perifricos integrados:

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Paso por cero temporizador T0.

Paso por cero temporizador T1.
Paso por cero temporizador T2.
Paso por cero temporizador de comparacin CT.
Recepcin/Transmisin Canal Serie 0.
Recepcin/Transmisin Canal Serie 1.
Fin de conversin en el convertidor A/D.

7 Generadas por terminales de E/S.

 CARACTERSTICAS BSICAS 1.3

IDENTIFICACIN DE INTERRUPCIN:
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Flag asociado a cada fuente de interrupcin.

Vector de interrupcin asociado con cada fuente de interrupcin .
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PRIORIDAD:
4 niveles de prioridad programable.
Secuencia fija de prioridad dentro de cada nivel.

INHIBICION:
Inhibicin global.
Inhibicin individual.

BORRADO:
Automtico.
Manual (en la rutina de atencin a la interrupcin).
 INTERRUPCIONES EXTERNAS 0/1/2 1.4

INT0 (P3.2), INT1 (P3.3):

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Interrupcin por nivel lgico cero: IT0=0 e IT1=0 (TCON.0 y

TCON.2).
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Interrupcin por flanco de bajada: IT0=1 e IT1=1 (TCON.0 y

TCON.2).
Flags: IE0 e IE1 (TCON.1 y TCON.3).

INT2 (P1.4):
Interrupcin por flanco de bajada: 2FR=0 (T2CON.5).
Interrupcin por flanco de subida: I2FR=1 (T2CON.5).
Flag: IEX2 (IRCON.1).
 INTERRUPCIONES EXTERNAS 3/4/5/6 1.5

INT3 (P1.0):
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La programacin del flanco se realiza en I3FR de T2CON

(T2CON.6).
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Interrupcin por flanco de bajada: I3FR=0 (T2CON.6)

Interrupcin por flanco de subida : I3FR=1 (T2CON.6)
Flag: Bit IEX3 (IRCON.2).

INT4 (P1.1), INT5 (P1.2), INT6 (P1.3):

Interrupciones por flanco de subida.
Flags: IEX4, IEX5 e IEX6 (IRCON.3, IRCON.4 e IRCON.5).
SISTEMAS ELECTRNICOS DIGITALES. CURSO 04/05
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CONFIGURACIN EXT0/1
1.6
SISTEMAS ELECTRNICOS DIGITALES. CURSO 04/05
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1.7
SISTEMAS ELECTRNICOS DIGITALES. CURSO 04/05
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FLAGS IEX2/IEX3/IEX4/IEX5/IEX6
1.8
SISTEMAS ELECTRNICOS DIGITALES. CURSO 04/05
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INHIBICIN GLOBAL/EXT1/EXT2
1.9
SISTEMAS ELECTRNICOS DIGITALES. CURSO 04/05
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INHIBICIN EXT2/EXT3/EXT4/EXT5/EXT6
1.10
 PRIORIDAD DE INTERRUPCIONES 1.11

Las fuentes de peticin de interrupciones estn agrupadas

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en parejas o tros. Si aparecen de forma simultanea dos o

ms peticiones:
Si pertenecen a la misma pareja o tro, se resuelve segn 1.
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Si pertenecen a distinta pareja o tro pero con la misma prioridad

programada , la prioridad se resuelve segn 2.
1- Prioridad dentro del grupo 2- Prioridad
Mxima Mnima de los grupo
Externa 0 Canal Serie 1 Convertidor A/D
Mxima
Temporizador 0 - Externa 2
Externa 1 - Externa 3
Temporizador
Temporizador 1 Externa 4
Comparacin
Canal Serie 0 - Externa 5
Mnima
Temporizador 2 - Externa 6
 NIVELES DE PRIORIDAD DE INTERRUPCIONES 1.12

Por medio de los registros IP0 e IP1 se programa el nivel de prioridad

para cada pareja o tro.
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La atencin a una interrupcin solo puede ser interrumpida por otra

peticin de mayor prioridad
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 VECTORES DE INTERRUPCIN 1.13

Vector de interrupcin: Fuente de Vector de

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interrupcin Interrupcin -- Sistema Altair

direccin (Memoria de
Externa 0 0003H -- 8003H
Programa) de la primera
Tempo. T0 000BH -- 800BH
instruccin de la rutina de
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Externa 1 0013H -- 8013H

atencin.
Tempo. T 001BH -- 801BH
La CPU ejecuta una LCALL con Serie 0 0023H -- 8023H
dicho vector Tempo. T2 002BH -- 802BH
C A/D 0043H -- 8043H
Externa 2 004BH -- 804BH
Externa 3 0053H -- 8053H
Externa 4 005BH -- 805BH
Externa 5 0063H -- 8063H
Externa 6 006BH -- 806BH
Serie 1 0083H -- 8083H
CT 009BH -- 809BH
 BORRADO DE PETICIN DE INTERRUPCIONES 1.14

Fuente de Automtica al ser Manual en la rutina

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Interrupcin atendida de atencin

Paso por cero T0 Si
Paso por cero T1 Si
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Paso por cero T2 Si

Paso por cero de CT Si
Canal Serie 0 Si
Canal Serie 1 Si
Convertidor A/D Si
Flanco bajada en INT0 o INT1 Si
Nivel bajo en INT0 o INT1 No se puede borrar. La seal externa
determina el borrado
Flanco activo en INT2 Si
Flanco activo en INT3 Si
Flanco de subida en INT4, INT5, Si
INT6
 ATENCIN A LA INTERRUPCIN 1.15

Una interrupcin se atiende generando una instruccin LCALL

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(llamada a subrutina) a partir del ciclo mquina siguiente a su

deteccin siempre que no se d alguna de las tres circunstancias
siguientes:
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1. Se est atendiendo otra interrupcin de igual o mayor prioridad.

2. El ciclo mquina actual no es el ltimo de la instruccin que se est ejecutando.
3. La instruccin que se est ejecutando es RETI (retorno de interrupcin) o
alguna escritura o lectura a los registros IE o IP. En estos casos se ejecutar
adems la instruccin siguiente.

Si se da alguna de estas tres circunstancias, la interrupcin no ser

atendida hasta que finalice dicha accin siempre que:

La bandera de peticin de interrupcin siga activa.

No se haya pedido otra interrupcin de mayor prioridad durante la espera.
 Ejemplo 1.16

$include (reg537.pdf)
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ORG 8000h
AJMP inicio
ORG 8003h
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JMP Intext0 ; Direccin de la subrutina de atencin

ORG 8100h
Inicio:
SETB IT0 ; Configuracin por flanco
SETB EX0 ; Habilitacin interrupcin externa
SETB EA ; Habilitacin global de interrupciones
JMP $
Intext0: ; Subrutina de atencin a la interrupcin
PUSH ACC

POP ACC
RETI ; Retorno de interrupcin
END