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El curso se desarrolla durante 16 semanas y se encuentra distribuido en cuatro unidades. La primera unidad aborda los temas
relacionados con la representacin digital de los datos y el Algebra de Boole. La segunda y tercera unidad revisan los
conceptos relacionados con los circuitos combinacionales y secuenciales respectivamente. La cuarta busca desarrollar
habilidades para el diseo de Maquinas de Estados Finitos.
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Partiendo de la premisa que los analfabetos del siglo XXI no sern aquellos que no sepan leer y escribir, sino aquellos que no
sepan aprender, desaprender y reaprender, adicionalmente este curso busca desarrollar habilidades para el aprendizaje
autnomo, es decir, que el estudiante bajo la gua del docente pueda aprender por su propia cuenta. En este
sentido, en este curso el estudiante encontrar referencias bibliogrficas, tutoriales, video tutoriales y dems enlaces de
apoyo que faciliten el aprendizaje significativo de los contenidos del curso. Adems encontrar varios medios de comunicacin
sncrona (chat, Skype) y asncrona (foros, email) para que pueda recibir toda la orientacin que se requiera en el proceso de
aprendizaje.
2. INTENCIONALIDADES FORMATIVAS
Propsitos:
General
Facilitar el aprendizaje significativo de los conceptos relacionados con el diseo e implementacin de Sistemas Digitales,
mediante el la construccin significativa de cada de los conceptos relacionados con los circuitos combinacionales y
secuenciales.
Representar los datos utilizando diferentes sistemas de numeracin (binario, hexadecimal), con el fin de poder
representar digitalmente los datos.
Identificar las ecuaciones lgicas y los mtodos de simplificacin en el diseo de un circuito lgico para la solucin de
problemas prcticos
Disear circuitos combinacionales y secuenciales, usando unidades bsicas de procesamiento, direccionamiento y
almacenamiento.
Describir en VHDL un sistemas digital compuesto por elementos combinacionales y secuenciales.
Describir en VHDL mquinas de estados finitos (FSM) que permitan dar solucin a problemas de ingeniera.
Usar descripciones jerrquicas en VHDL para describir sistemas digitales compuestos por varios sub-sistemas.
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El estudiante representa los datos utilizando diferentes sistemas de numeracin (binario, hexadecimal), con el fin de
poder representar digitalmente los datos.
El estudiantes identifica las ecuaciones lgicas y los mtodos de simplificacin en el diseo de un circuito lgico para la
solucin de problemas prcticos
El estudiante disea sistemas digitales compuestos por unidades combinacionales y secuenciales, usando
apropiadamente las unidades bsicas de procesamiento, direccionamiento y almacenamiento.
El estudiante describe en VHDL un sistemas digital compuesto por unidades combinacionales y secuenciales.
El estudiante describe en VHDL mquinas de estados finitos que permiten dar solucin a problemas de ingeniera.
El estudiante hace correcto uso de las descripciones jerrquicas en VHDL para describir sistemas digitales compuestos
por varios sub-sistemas.
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Introduccin.
Algebra de Boole Principios fundamentales del
y Sistemas de Algebra de Boole
Numeracin Sistemas de numeracin.
Introduccin a VHDL.
Circuitos armticos
Bloques Bloques combinacionales
Aritmticos y Introduccin a VHDL - Circuitos
Combinacionales combinacionales.
VHDL - Diseo Jerrquico.
ELECTRNICA
DIGITAL Latches y Biestables (Flip-Flops)
Introduccin a VHDL - Circuitos
secuenciales.
Circuitos
Registros.
Secuenciales
Contadores
Detectores de Flanco y Divisores
de frecuencia
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Introduccin a VHDL: Fajardo, C. (2015, diciembre 13), Diseo de un circuito combinacional usando el
Instalacin del software ISE 14.7 [Archivo de video]. Recuperado de
software ISE http://hdl.handle.net/10596/9655
Referencias Chu, P. P. (2006). RTL Hardware Design Using VHDL : Coding for Efficiency, Portability, and Scalability.
bibliogrficas Hoboken, N.J.: Wiley-IEEE Press. (Chapter 1, pp 1-12). Recuperado de:
complementaria http://bibliotecavirtual.unad.edu.co:2048/login?user=proveedor&pass=danue0a0&url=http://bibliotecavirtual
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s .unad.edu.co:2051/login.aspx?direct=true&db=e000xww&AN=158127&lang=es&site=ehost-live
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OVI Unidad 3:
En este video se hace el diseo de un contador ascendente en VHDL. El video busca
Contadores,
orientar al estudiante en el diseo de contadores sncronos.
Detectores flanco y
Divisores de Fajardo, C. (2016, diciembre 13), Contadores Digitales. [Archivo de video]. Recuperado
Frecuencia. de http://hdl.handle.net/10596/9852
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Referencia Chu, P. P. (2006). RTL Hardware Design Using VHDL : Coding for Efficiency, Portability, and Scalability. Hoboken,
s N.J.: Wiley-IEEE Press. Recuperado
bibliogrfic de: http://bibliotecavirtual.unad.edu.co:2048/login?user=proveedor&pass=danue0a0&url=http://bibliotecavirtual.
as unad.edu.co:2051/login.aspx?direct=true&db=e000xww&AN=158127&lang=es&site=ehost-live
compleme
ntarias
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4. ACTIVIDADES DE APRENDIZAJE
Indicador N Evaluacin1
Contenido
|Unid Competen es de Estrategia de de
de Criterios de Ponderaci
ad cia desempe Aprendizaje Se Propsito
Aprendizaje evaluacin n
o m
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El Identifica
estudiante las Paso 1 - Actividad de
representa expresion reconocimiento Paso 1 -
los datos es En este espacio del Identificar Identifica de Actividad de
utilizando booleanas entorno de aprendizaje las manera Reconocimie
diferentes para colaborativo deber ecuaciones adecuada la nto.
UNID lgicas y los expresin 25 puntos
sistemas de circuitos realizar de manera
AD1 mtodos de lgica y la
numeracin lgicos INDIVIDUAL
Repres Representaci simplificacin tabla de
(binario, combinaci
entaci n Digital de en el diseo verdad.
hexadecima onales Un mensaje de
n los Datos: de circuito
l), con el fin Bienvenida en el Foro de
Digital Sistema lgicos para Aplica
de poder Aplica los la actividad de
de los Binario, 3 la solucin correctament
representar teoremas reconocimiento de
Datos Hexadecimal de e los
digitalment de Presaberes, describiendo
y y problemas teoremas de
e los datos. simplificac brevemente nuestra vida,
Algebr Complement prcticos simplificacin
in de nuestros intereses y
a de o a 2. del algebra
El expresion acciones.
Boole de Boole
estudiantes es lgicas.
identifica Informacin actualizada
las El en el perfil nuestro del
ecuaciones estudiante campus, principalmente Estructura
lgicas y simplifica aquella que hacemos de manera
los mtodos funciones pblica a nuestros correcta el
de lgicas compaeros de curso. informe
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estudiantes vayan
trabajando durante las
tres semanas en los
ejercicios y no dejen todo
para el final. De igual
manera cada estudiante
deber retro-alimentar
las soluciones de sus
dems compaeros,
aprobando sus respuestas
o encontrando posibles
errores u otras
alternativas de solucin.
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El
estudiante
identifica
las
diferencias
en
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implementa
cin entre
las
sentencias
with-select
y when-
else.
El
estudiante
hace uso de
descripcion
es
jerrquicas
para la
implementa
cin de
circuitos
combinacio
nales.
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Latches y
El Reconoce
Flip-flops
estudiante la Paso 5 Trabajo Comprender Identifica las
identifica al diferencia Colaborativo 3 el diferencias
diferencia entre los funcionamien entre un
entre un sistemas En esta fase cada 3 to y la sistema Paso 5
circuito secuencial estudiante deber utilizar de los secuencial Trabajo
Registros
combinacio es resolver los ejercicios principales sncrono y Colaborativo
nal y un sncrono y propuestos en la circuitos asncrono 3.
circuito asncronos actividad colaborativa y combinacion 50 puntos
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contadore Participa
s en asertivament
El VHDL. e dentro del
estudiante foro
identifica la Disea
estructura diferentes
bsica de tipos de
los Registros
diferentes en VHDL.
tipos de
registros.
El
estudiante
comprende
la
estructura
bsica de
un
contador.
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El Disea
Divisores de estudiante Paso 6: Componente correctament
Frecuencia disea prctico. Disear e divisores
divisores de divisores de de Paso 6
frecuencia Disea frecuencia, frecuencia, a Componente
mediante la divisores como una partir de las prctico.
Diseo
correcto de Cada estudiante deber combinacin caracterstica 180 puntos.
jerrquico:
diseo de frecuencia preparar el componente de circuitos s del mismo.
Circuitos
un . prctico, teniendo en combinacion
secuenciales
diagrama cuenta los lineamientos ales y
y
de bloques. Describe dados en la Gua de 3 secuenciales. Disea
combinacion
en VHDL Componente Prctico. correctament
ales.
El mquinas e un
estudiante de estados Este componente prctico Disear diagrama de
comprende Finitos. es tipo virtual, es decir, el mquinas de estado que
el estudiante lo realiza en estado por soluciona un
paradigma Diferencia su casa y enva las medio de problema
Simulacin de las dos evidencias. Tal como se diagramas especfico.
de archivos funcionamie topologas describe en la gua de de estados
de alto nivel. nto de la principales esta actividad. que A partir de
UNID Mquinas de la describan el un diagrama
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correcta
descripcin
en VHDL.
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efectivamente el diseo es
se ajusta a las requeridas.
funcionalidades
requeridas en el presente
diseo.
El grupo colaborativo
entregara un documento
pdf con la estructura y las
indicaciones dada en la
gua integrada de
Acrividades.
Autoevaluacin Formativa
Coevaluacin Formativa
75% 375
Heteroevaluacin
Evaluacin Final 25% 125
Total 500
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