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LYCEE MED ALI ANNABI

RAS DJBEL

REPUBLIQUE TUNISIENNE
MINISTERE DE LEDUCATION
SECTION :

DEVOIR DE CONTRLE N1
Dure : 2 heures

SCIENCES TECHNIQUES

Epreuve :

GENIE ELECTRIQUE

me

SC.TECH3

8-11-2012

Nom :Prnom :.N :. Classe : 4me SC.Tech3

B- PARTIE ELECTRIQUE
I-Etude de ladditionneur : ( 9.5 Pts)
1- complter la table de vrit dun additionneur complet des deux nombres de 1 bits ;
(Si : somme ; Ci+1 : la retenue de sortie ; Ci : la retenue dentre ; ai et bi : bits dentres ) .
ai
0
0
0
0
1
1
1
1

bi
0
0
1
1
0
0
1
1

Ci
0
1
0
1
0
1
0
1

Ci+1

2-

Si

Donner les quations logiques simplifies des


sorties.
Ci+1=
Si=

3- Complter le logigramme de ladditionneur complet.


4ai
0

U1

U2

Si
?

XOR

XOR

bi
0

Identifier les bocs


C1 et C2.

Ci
0

U4

U3

AND
AND

C1

C2
U5

Ci+1
?

OR

5- Mettre les entres et les sorties et complter le traage du schma synoptique de de


ladditionneur des deux nombres A (a3a2a1a0) et B (b3b2b1b0)

+
Dossier pdagogique

+
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6- On souhaite transformer le montage prcdent en un additionneur / soustracteur.


On rappelle que dans la reprsentation en complment 2 . A B A (B) A B 1.
Cet additionneur / soustracteur possdera une entre de commande (ADD) qui sera utilise
comme suit :
* ADD= 0,fonctionnement
en additionneur
* ADD= 1,fonctionnement
en soustracteur
a- complter la table de
vrit suivante ( Yi est
limage de bit bi ou son
complment selon
lopration ).

ADD

bi

Yi
Yi =

b- Complter le schma synoptique de ladditionneur soustracteur.


b3

a3

b2

a2

b1

a1

b0

a0
ADD

Y3

Y2

Y1

Y0

7- le complmenteur 2 est un circuit qui effectue le complment deux dun nombre binaire
( complment 2 de A A 1).
En se rfrent au dossier technique ( circuit additionneur page 3/4 ) Complter le schma de
cblage de ce complmenteur 2 4 bits.

Dossier pdagogique

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II- Etude du comparateur : ( 1.5 Pts )


Le comparateur existant dans le systme comporte les trois cellule suivante :
- additionneur 1 bit - comparateur 1 bit - porte logique ou exclusif
1-Pour A :A0 et B :B0 , tracer le logigramme ralisant la fonction S suivante :
-

Si A B : S = A + B - Si A B : S = A - B

.
..

A=B
A>B

Comparateur
1bit

S
III- Etude de lUAL : ( 9 Pts )
LUAL implant dans ce systme travaille sur des mots binaires , ( page 2/4 dossier technique ).
Entres A et B , Retenue dentre re sous forme complmente Sortie S.
Retenue de sortie rs sous forme complmente Fonction G et P sur 4 bits sous forme
complmente 5 entres de commande M avec M = 0 pour les oprations logiques et M = 1 pour
les oprations arithmtiques f3 f2 f1 f0 pour 16 oprations distinctes .
Elle est ralise selon le schma de la figure 1 page 2/4, en deux parties :
- Un gnrateur de fonctions Gi et Pi ( sous forme complmente )
- Un additionneur rapide avec calcul de retenue .
1- Mettre une croix devant la bonne rponse :
L UAL travaille sur des mots de :
16bits
4bits
8bits
2- Quel est le nombre des oprations totale ralise par cette unit ?
..
En mode logique ( M = 0 ) :
1- Daprs la figure 2 du dossier technique page 2/4 donner les quations de Gi et Pi en fonctions
des entres ai , bi et les entres de commandes f0 , f1 , f2 et f3
Gi = Pi =
2- Donner la valeur de la sortie S Gi Pi pour les combinaisons suivantes :
f3

f2

f1

f0

Dossier pdagogique

Gi

Pi

Pi

Si

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En mode arithmtique ( M = 1 ) :
ri-1 est la retenue provenant de ltage prcdant. La figure 1 page 2/4 donne les sorties Si.
1- Donner lquation de Si daprs la figure 1
Si = .
2- Donner la valeur de la sortie S pour les combinaisons suivantes :
ri-1

f3

f2

f1

f0

Gi

Pi

Gi

Si

VI / On dsire amliorer la carte de commande automatique de l'unit en ajoutant une Unit


Arithmtique et logique "UAL" 4 bits 74 181 .
1 / Citer les oprations de base ralises par l'UAL
..
2 / Citer les lment de base constituant un UAL

3 / Donner la diffrence entre une UL et une UAL


..
..
4 / Identifier les sorties :
M :..
Cn :..
A = B : ..
En se rfrant au schma structurel du circuit de calcul numrique reprsent au dossier technique
analyser le fonctionnement et complter le tableau suivant.
A
B
Additionneur :U1 Comparateur : U2
UAL : U3
A4 A3 A2 A1 B4 B3 B2 B1 S4 S3 S2 S1 QA<S QA=S QA>S Opration F3 F2 F1 F0
1

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