SUPER PROCESADOR 3000

PRODUCT DESIGN SPECIFICATION

Version 1.0
03/13/2015

Super procesador 3000 1.0

VERSION HISTORY
Version
#
1.0

Implemented
By
Erick Bonifaz

Revision
Date
03/10/2015

Approved
By
Nataly
Medina

Approval
Date
Pendiente

Reason
Initial Design Definition
draft

UP Template Version: 03/15/15

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Super procesador 3000 1.0

TABLE OF CONTENTS
1 INTRODUCTION...........................................................................................................5
1.1
Purpose of The Product Design Specification Document..............................5
2 GENERAL OVERVIEW AND DESIGN GUIDELINES/APPROACH............................5
2.1
Assumptions / Constraints / Standards..........................................................5
3 ARCHITECTURE DESIGN...........................................................................................5
3.1
Logical View...................................................................................................5
3.2
System Buses................................................................................................5
4 SYSTEM DESIGN.........................................................................................................6
4.1
Instruction Set................................................................................................6
4.2
Data Format...................................................................................................6
5 PRODUCT DESIGN SPECIFICATION APPROVAL....................................................7

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Super procesador 3000 1.0

1. INTRODUCTION
1.1

PURPOSE OF THE PRODUCT DESIGN SPECIFICATION DOCUMENT

En este documento de especificaciones se proporcionara lo necesario para el
entendimiento del funcionamiento de este Super procesador 3000, as como su
arquitectura y especificaciones que esta tiene.

2. GENERAL OVERVIEW AND DESIGN GUIDELINES/APPROACH

1.2

ASSUMPTIONS / CONSTRAINTS / STANDARDS

El sper procesador 3000 tiene una arquitectura propia. El set de instrucciones es
CISC. El clock que se implemento es manual para poder ver como se comportaba
el procesador, por cada fase de instruccin necesitaba 8 ciclos de reloj. La
arquitectura se manej a 8 bits.

3. ARCHITECTURE DESIGN
Esta seccin presenta el diseo de la arquitectura del sistema y el hardware que ser
construido. Los circuitos y sus funciones usadas en este CPU se explicaran a
continuacin:
Aritmetic logic device (ALU): Hace las operaciones que el usuario quiere. Es
capaz de hacer 4 operaciones; suma, resta, AND y OR. Todos de 4 bits.
Unidad de control: Este elemento procesa y categoriza las operaciones
disponibles.
Memory adress register (MAR): Es el registro donde guarda la direccin en la
memoria.
Memory data register (MDR): Registro donde guarda temporalmente los datos
Instruction Register (IR): Recibe las instrucciones para saber qu operacin se
va a realizar en la ALU.

3.1 LOGICAL VIEW

En la siguiente imagen se observara como fue hecho el sumador y el restados de
4 bits.

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3.2 SYSTEM BUSES

Este procesador tiene 3 tipos de buses
Bus para adress (adress bus)

Bus para datos (data bus)

Bus para instrucciones (instruction bus)

4. SYSTEM DESIGN
4.1 INSTRUCTION SET
Las instrucciones que el super porcesador 3000 puede hacer estan enlistadas en
la siguiente tabla. Este procesador es capaz de hacer 4 operaciones. En la
siguiente table se presenta el numero de ciclos de reloj necesario para completer
el proceso y obtener el resultado.
INSTRUCCIN

EJEMPLO

CICLOS RELOJ

DESCRIPSION

Reset

1100 pasa a 0000

Elimina
todo
guardado
en
memoria

Suma

1111+1001

Suma binaria de 4
bits

Resta

1100-1010

Resta binaria de 4
bits

AND

OR

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lo
la

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4.2 DATA FORMAT

4 BITS

4 BITS

DATOS A

DATOS B

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3 BITS
OPERACIN

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5. PRODUCT DESIGN SPECIFICATION APPROVAL

Los firmantes reconocen que han revisado el documento Super procesador 3000,
documento de producto, especificaciones y diseo y estoy de acuerdo con el
enfoque que presenta. Cualquier cambio a este documento sern coordinadas
con y aprobados por el firmante o sus representantes designados.

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