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ARQUITETURA DE COMPUTADORES
Introduo arquitetura e organizao de computadores
Plano de Aula
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Modelo de Von-Neumann
Bsico CPU Mmoria E/S Barramentos
Computer Architecture is the science and art of selecting and interconnecting hardware components to create computers that meet functional, performance and cost goals. goals . Computer architecture is not about using computers to design buildings. buildings.
William Stallings
Arquitetura de Computadores
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Decadas de 30-40
Calculadoras mecnicas
Decada de 40
Primeira Gerao
Vulvulas Eletronicas Estudos Militares Eniac (Eletronic Numerical Integrator and Computer)
Decada de 60
Terceira Gerao
Circuitos Integrados
Decada de 70
Quarta Gerao
Primeiro microprocessador comercial (Intel) PCs XT -- AT X86 --Pentium
Decada de 90
Quinta Gerao
Aplicaces Multimdia Pentium MMX Pentium II Pentium III
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Nano Tecnologia
Arquitetura de Computadores
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Unidade de Entrada/Saida
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Unidade de Controle
Permite que as operaes sejam realizadas pela ordem ou sequncia correcta. Busca da instruo na memoria de programa Decodificao da instruo (tabela dos codicos das instrues, especifica para cada microprocessador) Execuo das Instrues (unidade operacional controlada pelos sinais de controle)
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Cdigo de operando:
Dados necessrios execuo da operao
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Atividade da CPU
Busca (fetch) unidade de memria da prxima instruo a ser executada.
Este processo desencadeado atravs do envio, para a memria, da localizao (endereo) da instruo a ser executada. Aps esta solicitao, ento recebida a instruo pretendida;
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Atividade da CPU
Descodificao da instruo
Identificado o que vai ser processado, definidos pelos os tipos de operandos
Dados Operadores
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Atividade da CPU
Carregamento dos operandos
Transferncia dos operandos da unidade de memria para os registos internos (especificados pela instruo a processar)
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Atividade da CPU
Execuo da operao especificada pela instruo. Para isso so enviados os sinais apropriados para os subsistemas ALU, memria e E/S.
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Atividade da CPU
Envio do resultado do processamento para a unidade de memria ou, em alternativa e caso seja necessrio, o armazenamento temporrio nos registos internos.
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Nmero de operandos: 0, 1, 2, 3, ... O operando pode indicar o valor diretamente ou um endereo, em memoria, onde se encontra o valor
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Registrador de Instruo
Contem a instruo (codigo) lida da memria e que ser executada.
FASE DE EXECUO DA INSTRUO A instruo decodificada (interpretada) Sinais so gerados para a execuo da instruo.
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Ciclo de busca
Buscar a prxima instruo na memria Incrementar o CP (Contador de Programa)
Ciclo de execuo (Execute Cycle)
Ciclo de Execuo
Interpretar a instruo Trazer (se for o caso) os operandos para a UCP Executar a operao Armazenar (se for o caso) os dados de sada Atualizar (se for o caso) o CP Repetir o processo com uma nova instruo
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Contadores-Multiplexadores-SeletoresDecodificadores-Somadores-Portas lgicas
Operam com informaes, fornecendo como resultado, novo dado da operao que realizam.
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Arquitetura de Computadores
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Memria
11111110 [2N -2] 11111111 [2N -1] Clula de memria de L bits Contedo de memria de 2N X L bits
Se N=16 e L=8
Espao de endereamento 216 = 65536 posies.
Cada um destes 65536 endereos corresponde a uma clula independente Em cada clula so utilizados 8 bits para poder guardar a informao
Capacidade mxima em bits 65536 * 8 = 524288 bits
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000Ah
Endereos
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000Ah
Endereos
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A largura do barramento determinada pelo nmero de linhas de dados. Quanto maior for a largura apresentada pelo barramento, maior ser a capacidade de transporte em simultneo de informao. Para um barramento de largura n, fala-se numa palavra de n bits que transmitida num ciclo de relgio. A largura de banda de um barramento a quantidade de bits que pode ser transmitida pelo barramento num segundo.
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RD
Operaes de Leitura. Memria I/O CPU
WR
Operaes de Escrita. CPU Memria I/O
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Exerccio:
Suponha um modelo de arquitetura com um barramento de largura igual a 32 linhas. Qual a sua capacidade de endereamento?
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Conectores
Conecta perifricos do sistema
PCI AGP PCIe
Estes barramentos conectam o system bus atravs de uma bridge (ponte) que compe o chipset e funciona como gestor de trafego, integrando dados de outros barramentos no system bus
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Perifricos ISA
Perifricos PCI