Intel Confidential

UNIVERSIDAD CATLICA ANDRS BELLO

FACULTAD DE INGENIERA
ESCUELA DE INGENIERA EN TELECOMUNICACIONES

INTEGRANTES:
DOS SANTOS XAVIER
CORCEGA JOS

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o El procesador i7 es un procesador de la serie 900 que
soporta la arquitectura Intel 64.
o Ofrece avances significativos en cuanto a desempeo, lo que
incluye mejoras importantes en grficos, duracin de la
batera y seguridad.



Algunas de estas caractersticas son:
Hyper-Threading
Intel Turbo Boost
Enhanced Intel Smart Cache
L3 cache
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Hyper-Threading
Permite incrementar la velocidad
de procesamiento de los ncleos
por encima de la frecuencia
operativa nominal
Permite que cada ncleo de procesador funcione en
dos tareas al mismo tiempo para optimizar la
multitarea. El resultado es una mejora en el
rendimiento del procesador
Intel Turbo Boost
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Enhanced Intel Smart Cache
Define dentro de cada ncleo un
modelo reformulado de la jerarqua de
la memoria cache, el L3 se encuentra
fuera del ncleo y es mucho mayor y
mas inteligente con 8Mb que las
instrucciones L2 y L1
Permite al usuario configurar la memoria cache entre
el disco duro y la memoria de sistema.
L3 cACHE
Diagrama de la Arquitectura del procesador i7
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Es una memoria de alta velocidad y poca capacidad,
integrada en el microprocesador, que permite guardar
transitoriamente y acceder a valores muy usados,
generalmente en operaciones matemticas
Los registros de segmento (CS, DS, SS, ES, FS y GS) tienen selectores
de segmento de 16 bits. Un selector de segmento es un puntero
especial que identifica un segmento en la memoria. Para acceder a un
segmento particular en la memoria, el selector para ese espacio debe
estar presente en el registro de segmento apropiada.
Registros de segmentos
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Contiene 8 registros generales EAX,
EBX, ECX, EDX, ESI, EDI, EBP y ESP,
los cuales permiten operaciones
lgicas, aritmticas, clculo de
direcciones y punteros de memoria
Los 16 bits inferiores de los registros
de propsito general se asignan
directamente al conjunto de registros
que se encuentra en los procesadores
8086 e Intel 286 de nombres de AX, BX,
CX, DX, BP, SI, DI, y SP, que a su vez
pueden ser referenciados por los
nombres AH, BH, CH, y DH (parte alta
de los bytes) y AL, BL, CL y DL (parte
baja de los bytes).
Registros de propsito general 32 BITS
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TIPO DE REGISTRO 32 BITS 64 BITS
REGISTROS BYTE
7 7
En el modo de 64 bits, hay 16 registros de
propsito general, los registros son capaces de
trabajar con 32bits pero que hay 8 registros ms
habilitados de R8D-R15D que seran RAX, RBX,
RCX, RDX, RDI, RSI, RBP, RSP, R8-R15 y estaran
disponibles R8D-R15D.
REGISTROS DE TRABAJO
DOBLES REGISTROS DE
TRABAJO
CUADRUPLE REGISTRO
AL,BL,CL,DL,AH,BH,CH,DH
AL,BL,CL,DL,DLI,BPL,SPL,RBL-R15L
AX,BX.CX.DX.DI.SI,BP,SP AX,BX.CX.DX,DI,SI,SP,R8W-R15W
EAX,EBX,ECX,EDX,ESI,EBP,ESP
EAX,EBX,ECX,EDX,EDI,ESI,EBP,ESP,
R8D-R15D
N/D
RAX,RBX,RCX,RDX,RDI,RSI,RBP,
RSO,R8-R15
Registros de PROPSITO
GENERAL 64 BITS
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El registro EFLAGS 32 bits
contiene un grupo de
banderas de estado, una
bandera control, y un grupo
de banderas del sistema. En
la figura 1 se definen las
banderas dentro de los
registros
EFLAGS (REGISTRO DE BANDERAS)
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Es un registro que contiene el offset en el segmento del cdigo actual para
la siguiente instruccin a ser ejecutada. Avanza de un lmite de una instruccin
a la otra en lnea recta o se mueve adelante o atrs por un nmero de
instrucciones cuando se ejecutan JMP, JCC, CALL, RET, y IRET. Este registro
no puede ser accesado directamente por software, es controlado implcitamente
por instrucciones de control de transferencia, interrupciones y excepciones.
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INMEDIATO
En la instruccin est incluido
directamente el operando.
El operando es
especificado en la
instruccin misma.
El campo del operando
contiene el operando
actual que se debe utilizar
en conjunto con la
operacin especificada en
la instruccin.
Las instrucciones
de modo inmediato
son tiles para
inicializar los
registros en un
valor constante.
Algunas instrucciones
usan data codificada en
la instruccin como
fuente del operando.
Estos son llamados
operandos inmediatos.
Ejemplo : MOV AL,16H
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REGISTRO
La fuente y el destino del
operando pueden estar
seguidas de registros,
dependiendo como la
instruccin sea ejecutada.
Ejemplo : MOV AL,BL
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MEMORIA
Fuente y destino est en la memoria
y se referencian por un selector de
segmentos y un offset .


El selector de segmentos especifica que
segmentos contiene el operando .


El offset especifica la direccin
efectiva del operando. En modo de
64bits el offset puede ser de 64bits.
.
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INDIRECTO
El campo de operando contiene una
direccin de memoria, en la que se
encuentra la direccin efectiva del
operando.
Ejemplo: MOV A,@17H
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La Parte del offset de la memoria puede ser especificado por un valor
esttico (llamado un desplazamiento) o a travs de una direccin
computada formada de:

Desplazamiento: un valor de 8,6 o 32bits
Base: el valor de un registro general
Index: el valor de un registro general
Factor escalado: un valor de 2,4 u 8 que es
multiplicado por el valor index
Las combinaciones mas comunes sugieren:
Desplazamiento: solo un desplazamiento
representa un offset directo, como el
desplazamiento esta codificado en la
instruccin se le llama direccin absoluta
o esttica
Base: solo una base representa un offset
indirecto, porque el valor del registro
base puede cambiar.
Base + desplazamiento: se usa con dos
propsitos. Como un index en un
conjunto de elementos de tamao que
no es de 2,4 u 8bytes. Y tambin para
acceder a un campo de un registro,
donde la base tiene la direccin donde
empieza el registro, mientras que el
desplazamiento es un offset esttico
del campo.
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Debido a que las instrucciones para el procesador
Intel Core i7 son muy extensas, en este trabajo se
nombraran algunas asi como tambin los nuevos
protocolos implementados que son el AVX y el AVX2.
Se detallan las instrucciones que un
procesador de una computadora puede
entender y ejecutar, es decir el conjunto de
todos los comandos implementados por un
diseo particular de un procesador.
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AVX es una nueva extensin del conjunto de
instrucciones de 256 bits para Intel SSE y
se dise para aplicaciones que usan
Floating Point (FP - Punto flotante). Intel AVX
mejora el desempeo gracias a vectores ms
anchos, nueva sintaxis ampliable y
funcionalidad enriquecida. Esto resulta en
una mejor administracin de los datos y las
aplicaciones para fines generales como el
procesamiento de imgenes, sonido/video,
simulaciones cientficas, anlisis
financieros, y modelos y anlisis
tridimensionales.
Intel aadi ms funcionalidades vectoriales
en las sucesivas generaciones de
procesadores a partir del Haswell, se ampli
el juego de AVX con nuevas instrucciones
que funcionan tambin sobre nmeros
naturales, efectivamente ampliando casi la
totalidad del conjunto SSE de 128 a 256 bits.
AVX2 se introdujo en la arquitectura
inmediatamente posterior a Bridge, es decir
la Intel Haswell. Por los dems, comparten
todas las caractersticas de las AVX
originales.
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Transferencia de Datos
Copian datos de un origen a un destino, sin modificar
el origen y normalmente sin afectar a los flags o
indicadores de condicin. Pueden transferir palabras,
fracciones de palabras (bytes, media palabra) o
bloques completos de n bytes o palabras.
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Instrucciones Aritmticas
Son efectuadas por la ALU y suelen cambiar los flags
o indicadores de condicin.
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Instrucciones Lgicas
Realizan operaciones booleanas "bit a bit" entre dos
Operandos. Como las aritmticas tambin modifican
los flags.
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Instrucciones Comparacin
No hay que pensar que las instrucciones de salto condicional
dependen de este repertorio, ya que lo nico que hace el salto
condicional es consultar los flags y salta si precede, pero no
depende de ninguna instruccin de comparacin. (De hecho
cualquier operacin aritmtica realizada anteriormente a un salto
condicional puede provocar que este "salte").
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Control de Flujo de Programa
Permiten modificar la secuencia normal de ejecucin de un
programa, puede hacerse por salto condicional relativo o absoluto.
GRUPO ACCION
Salto Incondicional Salta sin comprobar ninguna condicin.
Salto Condicional Salta si la condicin se cumple.
Llamada a Subrutinas Invoca la ejecucin de funciones anteriormente definidas.
Gestin de las
Interrupciones
Se usan para llamar a las rutinas de servicio de
interrupcin y esto se puede hacer por hardware o bien
por software. Necesita una instruccin similar a return
para retornar al contexto anterior pero restableciendo el
estado de la mquina, para no afectar a la aplicacin a la
cual se interrumpi (iret).
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Instrucciones de Desplazamiento
Pueden ser aritmtico o lgico y pueden incluir o no rotaciones.
Pueden ser de izquierda a derecha.
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Instrucciones de Bits
Comprueban un bit del operando y su valor lo reflejan en el
indicador de cero. Pueden poner un bit a 0 o complementarlo.
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El procesador permite
transferir datos de o a un
puerto de entrada/salida (I/O).




Estos puertos son
configurados para el manejo
de perifricos, estos puertos
pueden ser unidireccionales
solo entrada o salida o
bidireccionales

Los puertos I/O son
accedidos mediante
instrucciones
especficas y un
mecanismo de
proteccin especial,
cuando hablamos de
direccin de memoria
separada
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Manejo de perifricos tambin
es hecho por interrupciones las
cuales son seales que alteran el
funcionamiento normal del CPU.




Libera el CPU del tiempo de
espera por eventos. Proveen
control para las entradas
externas.

Cuando se controlan
dispositivos I/O es
importante que las
operaciones sean
llevadas a cabo
precisamente en el orden
programado por lo tanto
se establece una
jerarqua donde el de
menor orden es el que se
ejecuta primero. En la
figura 2 podemos ver
como el i7 maneja
perifricos y el uso de los
puertos I/O
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